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      Entretien pour ASIC Design Engineer

      25 avr. 2019
      Employé (anonyme)
      Hyderâbâd

      Autres retours d’entretien d’embauche pour un poste comme ASIC Design Engineer chez Wafer Space

      Entretien pour ASIC Design Engineer

      3 mai 2019
      Candidat à l'entretien anonyme
      Aucune offre
      Expérience neutre
      Entretien difficile
      Offre acceptée
      Expérience positive
      Entretien difficile

      Candidature

      J'ai postulé en ligne. J'ai passé un entretien chez Wafer Space (Hyderâbâd) en juin 2018

      Entretien

      full of STA questions and protocols , verilog and sv programming questions digital design basic questions previous work experience verification bugs finding functional verification questions The manger asked about uart and spi protocol questions full of STA questions and protocols , verilog and sv programming questions digital design basic questions previous work experience verification bugs finding functional verification questions The manger asked about uart and spi protocol question

      Questions d'entretien [1]

      Question 1

      diff between false path and multi cycle path
      Répondre à cette question

      Candidature

      J'ai postulé via un établissement d'enseignement supérieur ou universitaire. Le processus a pris 1 jour. J'ai passé un entretien chez Wafer Space

      Entretien

      I applied through college and test was conducted in our college,For 3 hours. Later shortlisted candidates had 2/3 rounds of technical interviews. Lastly it was Managerial and HR interviews. Interview process was smooth and it was done within a day.

      Questions d'entretien [1]

      Question 1

      It was a written test with 4 parts of question, Giving a option to us to choose 3 parts among the 4, But with Aptitude compulsory. 1) Aptitude(10Q) 2)Digital circuit designing 3)Cmos and Vlsi design and 4)Vlsi coding verification questions
      1 réponse