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      Entretien pour Analog IC Design Engineer

      21 sept. 2024
      Candidat à l'entretien anonyme
      Shanghai, Shanghai
      Aucune offre
      Expérience neutre
      Entretien difficile

      Candidature

      J'ai passé un entretien chez VeriSilicon (Shanghai, Shanghai)

      Entretien

      3 continuous interviews (30min per interview), about each project introduction and some questions about circuit. They prefer to ask for slides of projects and choose one interested to ask you to introduce it.

      Questions d'entretien [1]

      Question 1

      Introduction for each project and details. A transfer function for active rc circuit. An Input/output impedance question.
      Répondre à cette question